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參數資料
| 型號： | ISP1761ET |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA128 |
| 封裝： | 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128 |
| 文件頁數： | 103/158頁 |
| 文件大?。?/td> | 724K |
| 代理商： | ISP1761ET |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁當前第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
103 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
In response to the standard USB request SET_ADDRESS, the firmware must write the
(enabled) peripheral address to the Address register, followed by sending an empty
packet to the host. The
new
peripheral address is activated when the peripheral receives
acknowledgment from the host.
10.4.2
Mode register (R/W: 020Ch)
This register consists of 2 B (bit allocation: see
Table 96
).
The Mode register controls resume, suspend and wake-up behavior, interrupt activity, soft
reset and clock signals.
[1]
The reserved bits should always be written with the reset value.
Table 94:
Bit
Symbol
Reset
Bus reset
Access
Address register: bit allocation
7
DEVEN
0
1
R/W
6
5
4
3
2
1
0
DEVADDR[6:0]
0
0
R/W
0
0
0
0
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
Table 95:
Bit
7
6 to 0
Address register: bit description
Symbol
DEVEN
DEVADDR[6:0]
Description
Device Enable
: Logic 1 enables the peripheral.
Device Address
: This field specifies the USB device peripheral.
Table 96:
Bit
Symbol
Mode register: bit allocation
15
14
13
12
11
10
9
8
reserved
[1]
DMACLK
ON
0
0
R/W
1
VBUSSTAT
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
4
R/W
3
R/W
2
R/W
0
CLKAON
0
0
R/W
SNDRSU
0
0
R/W
GOSUSP
0
0
R/W
SFRESET
0
0
R/W
GLINTENA
0
unchanged
R/W
WKUPCS
0
0
R/W
reserved
[1]
0
0
0
unchanged
R/W
R/W
Table 97:
Bit
15 to 10
9
Mode register: bit description
Symbol
Description
-
reserved
DMACLKON
DMA Clock On
:
1 —
Supply clock to the DMA circuit
0 —
Power saving mode. The DMA circuit will stop completely to save
power.
VBUSSTAT
V
BUS
Status
: This bit reflects the V
BUS
pin status.
8
相關PDF資料 |
PDF描述 |
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