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參數資料
| 型號： | ISP1761ET |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA128 |
| 封裝： | 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128 |
| 文件頁數： | 108/158頁 |
| 文件大小： | 724K |
| 代理商： | ISP1761ET |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁當前第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
108 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
The following registers are indexed:
Buffer Length
DcBufferStatus
Control Function
Data Port
Endpoint MaxPacketSize
Endpoint Type.
For example, to access the OUT data buffer of endpoint 1 using the Data Port register, the
Endpoint Index register must be written first with 02h.
Remark:
The Endpoint Index register and the DMA Endpoint Index register must not point
to the same endpoint.
[1]
The reserved bits should always be written with the reset value.
Table 105: Endpoint Index register: bit allocation
Bit
7
Symbol
reserved
[1]
Reset
0
Bus reset
0
Access
R/W
6
5
4
3
2
1
0
EP0SETUP
0
0
R/W
ENDPIDX[3:0]
0
0
R/W
DIR
0
0
R/W
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
Table 106: Endpoint Index register: bit description
Bit
Symbol
Description
7 to 6
-
reserved
5
EP0SETUP
Endpoint 0 Setup
: Selects the SETUP buffer for endpoint 0.
0 —
EP0 data buffer
1 —
SETUP buffer.
Must be logic 0 for access to endpoints other than endpoint 0.
4 to 1
ENDPIDX[3:0]
Endpoint Index:
Selects the target endpoint for register access of Buffer
Length, Control Function, Data Port, Endpoint Type and MaxPacketSize.
0
DIR
Direction bit:
Sets the target endpoint as IN or OUT.
0 —
Target endpoint refers to OUT (RX) FIFO
1 —
Target endpoint refers to IN (TX) FIFO.
Table 107: Addressing of endpoint 0 buffers
Buffer name
SETUP
Data OUT
Data IN
EP0SETUP
1
0
0
ENDPIDX
00h
00h
00h
DIR
0
0
1
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PDF描述 |
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