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參數資料
| 型號： | ISP1761ET |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA128 |
| 封裝： | 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128 |
| 文件頁數： | 32/158頁 |
| 文件大小： | 724K |
| 代理商： | ISP1761ET |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁當前第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
32 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
8.1 EHCI capability registers
8.1.1
CAPLENGTH register (R: 0000h)
The bit description of the Capability Length (CAPLENGTH) register is given in
Table 9
.
8.1.2
HCIVERSION register (R: 0002h)
Table 10
shows the bit description of the Host Controller Interface Version Number
(HCIVERSION) register.
8.1.3
HCSPARAMS register (R: 0004h)
The Host Controller Structural Parameters (HCSPARAMS) register is a set of fields that
are structural parameters. The bit allocation is given in
Table 11
.
0338h
033Ch
0340h
0344h
0354h
Interrupt registers
0310h
0314h
0318h
031Ch
0320h
0324h
0328h
032Ch
ATL Done Timeout
Memory
Edge Interrupt Count
DMA Start address
Power Down Control
0000 0000h
0000 0000h
0000 000Fh
0000 0000h
03E8 1BA0h
Section 8.3.7 on page 47
Section 8.3.8 on page 47
Section 8.3.9 on page 48
Section 8.3.10 on page 49
Section 8.3.11 on page 50
HcInterrupt
HcInterruptEnable
ISO IRQ Mask OR
INT IRQ Mask OR
ATL IRQ Mask OR
ISO IRQ Mask AND
INT IRQ Mask AND
ATL IRQ Mask AND
0000 0000h
0000 0000h
0000 0000h
0000 0000h
0000 0000h
0000 0000h
0000 0000h
0000 0000h
Section 8.4.1 on page 52
Section 8.4.2 on page 54
Section 8.4.3 on page 56
Section 8.4.4 on page 56
Section 8.4.5 on page 56
Section 8.4.6 on page 56
Section 8.4.7 on page 57
Section 8.4.8 on page 57
Table 8:
Address
Host Controller-specific register overview
…continued
Register
Reset value
References
Table 9:
Bit
7 to 0
CAPLENGTH register: bit description
Symbol
Access
CAPLENGTH
[7:0]
Value
20h
Description
Capability Length
: This is used as an offset. It
is added to the register base to find the
beginning of the operational register space.
R
Table 10:
Bit
15 to 0 HCIVERSION[15:0]
HCIVERSION register: bit description
Symbol
Access
R
Value
0100h
Description
Host Controller Interface Version Number
:
It contains a BCD encoding of the version
number of the interface to which the Host
Controller interface conforms.
相關PDF資料 |
PDF描述 |
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