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參數資料
| 型號： | ISP1761ET |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA128 |
| 封裝： | 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128 |
| 文件頁數： | 122/158頁 |
| 文件大小： | 724K |
| 代理商： | ISP1761ET |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁當前第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
122 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
[1]
The reserved bits should always be written with the reset value.
Bit
Symbol
Reset
Bus reset
Access
7
6
5
4
3
2
1
0
VBUS
0
0
R/W
DMA
0
0
R/W
HS_STAT
0
0
R/W
RESUME
0
0
R/W
SUSP
0
0
R/W
PSOF
0
0
R/W
SOF
0
0
R/W
BRESET
0
unchanged
R/W
Table 138: DcInterrupt register: bit description
Bit
Symbol
31 to 26
-
25
EP7TX
24
EP7RX
23
EP6TX
22
EP6RX
21
EP5TX
20
EP5RX
19
EP4TX
18
EP4RX
17
EP3TX
16
EP3RX
15
EP2TX
14
EP2RX
13
EP1TX
12
EP1RX
11
EP0TX
10
EP0RX
9
-
8
EP0SETUP
7
VBUS
6
DMA
5
HS_STAT
Description
reserved
Logic 1 indicates the endpoint 7 TX buffer as interrupt source.
Logic 1 indicates the endpoint 7 RX buffer as interrupt source.
Logic 1 indicates the endpoint 6 TX buffer as interrupt source.
Logic 1 indicates the endpoint 6 RX buffer as interrupt source.
Logic 1 indicates the endpoint 5 TX buffer as interrupt source.
Logic 1 indicates the endpoint 5 RX buffer as interrupt source.
Logic 1 indicates the endpoint 4 TX buffer as interrupt source.
Logic 1 indicates the endpoint 4 RX buffer as interrupt source.
Logic 1 indicates the endpoint 3 TX buffer as interrupt source.
Logic 1 indicates the endpoint 3 RX buffer as interrupt source.
Logic 1 indicates the endpoint 2 TX buffer as interrupt source.
Logic 1 indicates the endpoint 2 RX buffer as interrupt source.
Logic 1 indicates the endpoint 1 TX buffer as interrupt source.
Logic 1 indicates the endpoint 1 RX buffer as interrupt source.
Logic 1 indicates the endpoint 0 data TX buffer as interrupt source.
Logic 1 indicates the endpoint 0 data RX buffer as interrupt source.
reserved
Logic 1 indicates that a SETUP token was received on endpoint 0.
Logic 1 indicates V
BUS
is turned on.
DMA status
: Logic 1 indicates a change in the DMA Status register.
High Speed Status:
Logic 1 indicates a change from the full-speed to
high-speed mode (HS connection). This bit is not set, when the system
goes into the full-speed suspend.
Resume status:
Logic 1 indicates that a status change from suspend
to resume (active) was detected.
Suspend status:
Logic 1 indicates that a status change from active to
suspend was detected on the bus.
4
RESUME
3
SUSP
相關PDF資料 |
PDF描述 |
|---|---|
| ISP2100A | Telecommunication IC |
| ISP2100BN4 | Microprocessor |
| ISP2300 | Controller Miscellaneous - Datasheet Reference |
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| ISP1761ET,557 | 功能描述:USB 接口集成電路 USB 2.0 HS OTG HOST RoHS:否 制造商:Cypress Semiconductor 產品:USB 2.0 數據速率: 接口類型:SPI 工作電源電壓:3.15 V to 3.45 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:WLCSP-20 |
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