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參數資料
| 型號： | TSB12LV01B-EP |
| 英文描述： | FPGA (Field-Programmable Gate Array) |
| 中文描述： | 軍事增強塑料的高性能1394 3.3鏈路層電信。嵌入式 |
| 文件頁數： | 33/106頁 |
| 文件大小： | 605K |
| 代理商： | TSB12LV01B-EP |
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2
–
17
2.2.12
Bus Reset Register at 34h
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27
29 30 31
28
N
NODECNT
R
C
IRMNODEID
BUS NUMBER
NODE NUMBER
The power-up reset value of this register =
81BF_FFC0
’
h
.
NOTE:
The power-up reset value shown above assumes one node on the bus only. A
P1394a compliant Phy is assumed to be attached to the TSB12LV32. If a
1394-1995 Phy is attached to the TSB12LV32 link, the NODECNT filed will be 0.
This is due to the fact that a 1394-1995 compliant Phy does not report its self-ID
packet back to the local link.
BIT
NUMBER
BIT NAME
FUNCTION
DIR
DESCRIPTION
0
NRIDVAL
Valid
R
When set, NRIDVAL indicates that the Node ID, IRM Node ID,
Node Count, and Root information are valid. This bit is read
only.
1
RESERVED
Reserved
2
–
7
NODECNT
Node count
R
NODECNT contains the number of nodes detected in the
system. This field is loaded with 1 following a power-on reset.
The NODECNT field is read only.
8
ROOT
Root
R
Root is set when the current node is the root node. This bit is
read only.
9
CONTENDER
Contender
R
Contender contains the status of the TSB12LV32 CONTNDR
terminal. This bit is read only.
10
–
15
IRMNODEID
IRM node
identification
R
IRMNODEID is the isochronous resource manager node
identification. If there is no IRM node present on the bus,
these bits will be equal to 3Fh. These bits are read only.
16
–
25
BUSNUMBER
Bus number
R/W
BUSNUMBER is the 10-bit IEEE-1212 bus number. These
bits are set to 3FFh when RBUSNUM is set and there is a bus
reset.
26
–
31
NODENUMBER
Node
number
R/W
NODENUMBER is the node number of the current node.
These bits are automatically updated following a bus reset. To
change the node number of this node (spoofing), the
TESTMODE terminal must be set high.
相關PDF資料 |
PDF描述 |
|---|---|
| TSB12LV01BPZ | FPGA (Field-Programmable Gate Array) |
| TSB12LV26-EP | 672-pin FineLine BGA |
| TSB12LV22PZP | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
| TSB12LV26PZ | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
| TSB14AA1 | FPGA (Field-Programmable Gate Array) |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TSB12LV01BIPZT | 功能描述:1394 接口集成電路 High Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV01BIPZTEP | 功能描述:1394 接口集成電路 Mil Enh Hi Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV01BPZ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:BUS CONTROLLER |
| TSB12LV01BPZT | 功能描述:1394 接口集成電路 High Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV01BPZTG4 | 功能描述:1394 接口集成電路 High Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
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