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參數(shù)資料
| 型號： | ADSP-21161NCCA-100 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | DSP Microcomputer |
| 中文描述： | 48-BIT, 27.5 MHz, OTHER DSP, PBGA225 |
| 封裝： | 17 X 17 MM, MO-192AAF-2, BGA-225 |
| 文件頁數(shù)： | 11/60頁 |
| 文件大小： | 1019K |
| 代理商： | ADSP-21161NCCA-100 |
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–11–
REV. A
ADSP-21161N
JTAG Emulator Pod Connector
Figure 8
details the dimensions of the JTAG pod connector at the
14-pin target end.
Figure 9
displays the keep-out area for a target
board header. The keep-out area enables the pod connector to
properly seat onto the target board header. This board area
should contain no components (chips, resistors, capacitors, etc.).
The dimensions are referenced to the center of the 0.025" square
post pin.
Design-for-Emulation Circuit Information
For details on target board design issues including mechanical
layout, single processor connections, multiprocessor scan chains,
signal buffering, signal termination, and emulator pod logic, see
the
EE-68: Analog Devices
J
TAG Emulation Technical Reference
on
www.analog.com)—use site search
with improvements to emulator support.Additional Information
This data sheet provides a general overview of the ADSP-21161N
architecture and functionality. For detailed information on the
ADSP-2116x Family core architecture and instruction set, refer
to the
ADSP-21161 SHARC DSP Hardware Reference
and the
ADSP-21160 SHARC DSP Instruction Set Reference
.
Figure 7. JTAG Target Board Connector with No
Local Boundary Scan
TOP VIEW
13
14
11
12
9
10
9
7
8
5
6
3
4
1
2
EMU
GND
TMS
TCK
TRST
TDI
TDO
GND
KEY (NO PIN)
BTMS
BTCK
BTRST
BTDI
GND
Figure 8. JTAG Pod Connector Dimensions
Figure 9. JTAG Pod Connector Keep-Out Area
0.64"
0.88"
0.24"
0.10"
0.15"
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| ADSP-21262 | SHARC Processor |
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參數(shù)描述 |
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