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參數資料
| 型號： | ADSP-BF561 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 通用總線功能 |
| 英文描述： | Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70 |
| 中文描述： | 嵌入式Blackfin處理器的對稱多處理器 |
| 文件頁數： | 16/52頁 |
| 文件大小： | 508K |
| 代理商： | ADSP-BF561 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁當前第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁
Rev. PrC
|
Page 16 of 52
|
April 2004
ADSP-BF561
Preliminary Technical Data
PIN DESCRIPTIONS
ADSP-BF561 pin definitions are listed in
Table 8
. Unused
inputs should be tied or pulled to V
DDEXT
or GND.
Table 8. Pin Descriptions
Block
Pin Name
Type Signals Function
Driver
Type
A
A
A
Pull-up/down requirement
EBIU
ADDR[25:2]
DATA[31:0]
ABE[3:0]/SDQM[3:0]
O
I/O
O
24
32
4
Address Bus for Async/Sync Access
Data Bus for Async/Sync Access
Byte Enables/Data Masks for Async
/Sync Access
Bus Grant
Bus Request
Bus Grant Hang
Row Address Strobe
Column Address Strobe
Write Enable
Clock Enable
Clock Output Pin 0
Clock Output Pin 1
SDRAM A10 Pin
Bank Select
Bank Select
Hardware Ready Control
Output Enable
Write Enable
Read Enable
PPI Data / Programmable Flag Pins
PPI Data Pins
PPI Clock
PPI Sync / Timer
PPI Sync / Timer
PPI Sync
PPI Data / Programmable Flag Pins
PPI Data Pins
PPI Clock
PPI Sync / Timer
PPI Sync / Timer
PPI Sync
Emulation Output
JTAG Clock
JTAG Serial Data Out
JTAG Serial Data In
JTAG Mode Select
JTAG Reset
none
none
none
BG
BR
BGH
SRAS
SCAS
SWE
SCKE
SCLK0/CLKOUT
SCLK1
SA10
SMS[3:0]
AMS[3:0]
ARDY
AOE
AWE
ARE
PPI1D[15:8] /PF[47:40]
PPI1D[7:0]
PPI1CLK
PPI1SYNC1/ TMR8
PPI1SYNC2/ TMR9
PPI1SYNC3
PPI2D[15:8] /PF[39:32]
PPI2D[7:0]
PPI2CLK
PPI2SYNC1/ TMR10
PPI2SYNC2/ TMR11
PPI2SYNC3
EMU
TCK
TDO
TDI
TMS
TRST
O
I
O
O
O
O
O
O
O
O
O
O
I
O
O
O
I/O
I/O
I
I/O
I/O
I/O
I/O
I/O
I
I/O
I/O
I/O
O
I
O
I
I
I
1
1
1
1
1
1
1
1
1
1
4
4
1
1
1
1
8
8
1
1
1
1
8
8
1
1
1
1
1
1
1
1
1
1
A
-
A
A
A
A
A
B
B
A
A
A
-
A
A
A
C
C
-
C
C
C
C
C
-
C
C
C
C
-
C
-
-
-
none
pull-up required if function not used
none
none
none
none
none
none
none
none
none
none
pull-up required if function not used
none
none
none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
software configurable, none
none
internal pull-down
none
internal pull-down
internal pull-down
external down necessary if JTAG not
used
EBIU
(SDRAM)
EBIU
(ASYNC)
PPI1
PPI2
JTAG
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PDF描述 |
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參數描述 |
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