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參數資料
| 型號： | ADSP-BF561 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 通用總線功能 |
| 英文描述： | Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70 |
| 中文描述： | 嵌入式Blackfin處理器的對稱多處理器 |
| 文件頁數： | 38/52頁 |
| 文件大小： | 508K |
| 代理商： | ADSP-BF561 |
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Rev. PrC
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April 2004
ADSP-BF561
Preliminary Technical Data
Universal Asynchronous Receiver-Transmitter (UART)
Port—Receive and Transmit Timing
Figure 18
describes UART port receive and transmit operations.
The maximum baud rate is SCLK/16. As shown in
Figure 18
there is some latency between the generation internal UART
interrupts and the external data operations. These latencies are
negligible at the data transmission rates for the UART.
Figure 18. UART Port—Receive and Transmit Timing
RXD
DATA(5–8)
INTERNAL
UART RECEIVE
INTERRUPT
UART RECEIVE BIT SET BY DATA STOP;
CLEARED BY FIFO READ
CLKOUT
(SAMPLE CLOCK)
TXD
DATA(5–8)
STOP (1–2)
INTERNAL
UART TRANSMIT
INTERRUPT
UART TRANSMIT BIT SET BY PROGRAM;
CLEARED BY WRITE TO TRANSMIT
START
STOP
TRANSMIT
RECEIVE
AS DATA
WRITEN TO
BUFFER
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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