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參數資料
型號: ADSP-BF561
廠商: Analog Devices, Inc.
元件分類: 通用總線功能
英文描述: Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70
中文描述: 嵌入式Blackfin處理器的對稱多處理器
文件頁數: 24/52頁
文件大小: 508K
代理商: ADSP-BF561
Rev. PrC
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April 2004
ADSP-BF561
Preliminary Technical Data
Asynchronous Memory Read Cycle Timing
Table 14. Asynchronous Memory Read Cycle Timing
Parameter
Min
Max
Unit
Timing Requirements
t
SDAT
DATA15–0 Setup Before CLKOUT
2.1
ns
t
HDAT
DATA15–0 Hold After CLKOUT
0.8
ns
t
SARDY
ARDY Setup Before CLKOUT
4.0
ns
t
HARDY
ARDY Hold After CLKOUT
0.0
ns
Switching Characteristic
t
DO
Output Delay After CLKOUT
1
6.0
ns
t
HO
Output Hold After CLKOUT
1
0.8
ns
1
Output pins include AMS3–0, ABE3–0, ADDR25–2, AOE, ARE.
Figure 8. Asynchronous Memory Read Cycle Timing
t
DO
t
SDAT
CLKOUT
AMSx
ABE1–0
t
HO
BE, ADDRESS
READ
t
HDAT
DATA15–0
AOE
t
DO
t
SARDY
t
HARDY
ACCESS EXTENDED
3 CYCLES
HOLD
1 CYCLE
ARE
t
HARDY
ARDY
ADDR19–1
SETUP
2 CYCLES
PROGRAMMED READ ACCESS
4 CYCLES
t
HO
t
SARDY
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PDF描述
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