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參數(shù)資料
型號(hào)： ADSP-BF561
廠商： Analog Devices, Inc.
元件分類： 通用總線功能
英文描述： Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70
中文描述： 嵌入式Blackfin處理器的對(duì)稱多處理器
文件頁(yè)數(shù)： 36/52頁(yè)
文件大小： 508K
代理商： ADSP-BF561
Rev. PrC
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Page 36 of 52
|
April 2004
ADSP-BF561
Preliminary Technical Data
Serial Peripheral Interface (SPI) Port—Slave Timing
Table 26
and
Figure 17
describe SPI port slave operations.
Table 26. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Min
Max
Unit
Timing Requirements
t
SPICHS
Serial clock high period
2t
SCLK
-1.5
ns
t
SPICLS
Serial clock low period
2t
SCLK
-1.5
ns
t
SPICLK
Serial clock period
4t
SCLK
-1.5
ns
t
HDS
Last SCK edge to SPISS not asserted
2t
SCLK
-1.5
ns
t
SPITDS
Sequential Transfer Delay
2t
SCLK
-1.5
ns
t
SDSCI
SPISS assertion to first SCK edge
2t
SCLK
-1.5
ns
t
SSPID
Data input valid to SCK edge (data input setup)
1.6
ns
t
HSPID
SCK sampling edge to data input invalid
1.6
ns
Switching Characteristics
t
DSOE
SPISS assertion to data out active
0
8
ns
t
DSDHI
SPISS deassertion to data high impedance
0
8
ns
t
DDSPID
SCK edge to data out valid (data out delay)
0
10
ns
t
HDSPID
SCK edge to data out invalid (data out hold)
0
10
ns
相關(guān)PDF資料
PDF描述
ADSP-BF561SBB500 Blackfin Embedded Symmetric Multi-Processor
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ADSP-BF561SBB600 制造商:Analog Devices 功能描述:IC MULTIPROCESSOR
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