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參數資料
| 型號： | ISP1362EE |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Single-chip Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA64 |
| 封裝： | 6 X 6 MM, 0.80 HEIGHT, PLASTIC, MO-195, SOT-543-1, TFBGA-64 |
| 文件頁數： | 105/150頁 |
| 文件大?。?/td> | 647K |
| 代理商： | ISP1362EE |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁當前第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁
Philips Semiconductors
ISP1362
Single-chip USB OTG controller
Product data
Rev. 03
—
06 January 2004
105 of 150
9397 750 12337
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
15.8.5
HcINTLPTDSkipMap register (R/W: 18H/98H)
This is a 32-bit register, and the bit description is given in
Table 90
. Bit 0 of the
register represents the
fi
rst PTD stored in the INTL buffer, bit 1 represents the second
PTD stored in the buffer, and so on. When a bit is set by the HCD, the corresponding
PTD is skipped and is not processed by the HC. The HC processes the skipped PTD
if the HCD has reset its corresponding skipped bit to logic 0. Clearing the
corresponding bit in the HcINTLPTDSkipMap register when there is no valid data in
the block will cause unpredictable behavior of the HC.
Code (Hex): 18
—
read
Code (Hex): 98
—
write
15.8.6
HcINTLLastPTD register (R/W: 19H/99H)
This is a 32-bit register, and
Table 91
shows its bit description. Bit 0 of the register
represents the
fi
rst PTD stored in the INTL buffer, bit 1 represents the second PTD
stored in the buffer, and so on. The bit that is set to logic 1 by the HCD is used as an
indication to the HC that its corresponding PTD is the last PTD stored in the INTL
buffer. When the processing of the last PTD is complete, the HC proceeds to process
ATL transactions.
Code (Hex): 19
—
read
Code (Hex): 99
—
write
15.8.7
HcINTLCurrentActivePTD register (R: 1AH)
This register indicates which PTD stored in the INTL buffer is currently active and is
updated by the HC. The HCD can use it as a buffer pointer to decide which PTD
locations are currently free for
fi
lling in new PTDs to the buffer. This indication is to
prevent the HCD from accidentally writing into the currently active PTD buffer
location.
Table 92
shows the bit allocation of the register.
Code (Hex): 1A
—
read only
Table 89:
Bit
31 to 0
HcINTLPTDDoneMap register: bit description
Symbol
Access
Value
PTDDone
Bits[31:0]
Description
0
—
The PTD stored in the INTL buffer has not
been successfully processed by the HC.
R
0000H
1
—
The PTD stored in the INTL buffer has been
successfully processed by the HC.
Table 90:
Bit
31 to 0
HcINTLPTDSkipMap register: bit description
Symbol
Access Value
SkipBits
[31:0]
Description
0
—
The HC processes the PTD.
R/W
0000H
1
—
The HC skips processing the PTD.
Table 91:
Bit
HcINTLLastPTD register: bit description
Symbol
Acc
ess
31 to 0 LastPTD
Bits[31:0]
Value
Description
R/W
0000H
0
—
The PTD is not the last PTD stored in the buffer.
1
—
The PTD is the last PTD stored in the buffer.
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