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參數資料
| 型號： | ISP1362EE |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Single-chip Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA64 |
| 封裝： | 6 X 6 MM, 0.80 HEIGHT, PLASTIC, MO-195, SOT-543-1, TFBGA-64 |
| 文件頁數： | 64/150頁 |
| 文件大小： | 647K |
| 代理商： | ISP1362EE |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁當前第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁
Philips Semiconductors
ISP1362
Single-chip USB OTG controller
Product data
Rev. 03
—
06 January 2004
64 of 150
9397 750 12337
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
Table 26:
Bit
Symbol
OtgInterrupt register: bit allocation
15
14
13
12
11
10
9
8
reserved
OTG_TMR
_TIMEOUT
0
R/W
2
B_SESS_
END_C
0
R/W
B_SE0_
SRP
0
R/W
1
A_VBUS_
VLD_C
0
R/W
A_SRP_
DET
0
R/W
0
ID_REG_C
Reset
Access
Bit
Symbol
-
-
7
-
-
6
-
-
5
-
-
4
-
-
3
OTG_
RESUME
0
R/W
OTG_
SUSPND
0
R/W
RMT_
CONN_C
0
R/W
B_SESS_
VLD_C
0
R/W
A_SESS_
VLD_C
0
R/W
Reset
Access
0
R/W
Table 27:
Bit
15 to 11
10
OtgInterrupt register: bit description
Symbol
Description
-
reserved
OTG_TMR_
TIMEOUT
logic 1 clears this bit. Writing logic 0 has no effect.
This bit is set whenever the OTG timer attains time-out. Writing
0
—
no event
1
—
OTG Timer time-out
This bit is set whenever the device detects more than 2 ms of SE0.
Writing logic 1 clears this bit. Writing logic 0 has no effect.
9
B_SE0_
SRP
0
—
no event
1
—
bus has been in SE0 for more than 2 ms
This bit is used to detect the session request event (SRP) from the
remote device. The SRP event can be either V
BUS
pulsing or data
line pulsing. Bit 9 (A_SEL_SRP) of the OtgControl register
determines which SRP is selected. Writing logic 1 clears this bit.
Writing logic 0 has no effect.
8
A_SRP_
DET
0
—
no event
1
—
SRP is detected
This bit is used to detect a J to K state change when the device is
in the
‘
suspend
’
state. Writing logic 1 clears this bit. Writing logic 0
has no effect.
7
OTG_
RESUME
0
—
no event
1
—
a resume signal (J
→
K) is detected when the bus is in the
‘
suspend
’
state
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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| ISP1362EE,551 | 功能描述:USB 接口集成電路 DO NOT USE ORDER -T PART RoHS:否 制造商:Cypress Semiconductor 產品:USB 2.0 數據速率: 接口類型:SPI 工作電源電壓:3.15 V to 3.45 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:WLCSP-20 |
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