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參數(shù)資料
| 型號(hào)： | ISP1362EE |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Single-chip Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA64 |
| 封裝： | 6 X 6 MM, 0.80 HEIGHT, PLASTIC, MO-195, SOT-543-1, TFBGA-64 |
| 文件頁數(shù)： | 113/150頁 |
| 文件大小： | 647K |
| 代理商： | ISP1362EE |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁當(dāng)前第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁
Philips Semiconductors
ISP1362
Single-chip USB OTG controller
Product data
Rev. 03
—
06 January 2004
113 of 150
9397 750 12337
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
16.1 Initialization commands
Initialization commands are used during the enumeration process of the USB
network. These commands are used to con
fi
gure and enable the embedded
endpoints. They also serve to set the USB assigned address of the DC and to
perform a device reset.
16.1.1
DcEndpointCon
fi
guration register (R/W: 30H
–
3FH/20H
–
2FH)
This command is used to access the DcEndpointCon
fi
guration register (ECR) of the
target endpoint. It de
fi
nes the endpoint type (isochronous or bulk/interrupt), direction
(OUT/IN), buffer memory size and buffering scheme. It also enables the endpoint
buffer memory. The register bit allocation is shown in
Table 108
. A bus reset will
disable all endpoints.
The allocation of buffer memory only takes place after
all
16 endpoints have been
con
fi
gured in sequence (from endpoint 0 OUT to endpoint 14). Although the control
endpoints have
fi
xed con
fi
gurations, they must be included in the initialization
sequence and must be con
fi
gured with their default values (see
Table 14
). Automatic
buffer memory allocation starts when endpoint 14 has been con
fi
gured.
Remark:
If any change is made to an endpoint con
fi
guration that affects the allocated
memory (size, enable/disable), the buffer memory contents of
all
endpoints becomes
invalid. Therefore, all valid data must be removed from enabled endpoints before
changing the con
fi
guration.
Code (Hex): 20 to 2F
—
write (control OUT, control IN, endpoint 1 to 14)
Code (Hex): 30 to 3F
—
read (control OUT, control IN, endpoint 1 to 14)
Transaction
—
write or read 1 byte (code or data)
Table 108: DcEndpointCon
fi
guration register: bit allocation
Bit
7
Symbol
FIFOEN
EPDIR
Reset
0
Access
R/W
6
5
4
3
2
1
0
DBLBUF
0
R/W
FFOISO
0
R/W
FFOSZ[3:0]
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
Table 109: DcEndpointCon
fi
guration register: bit description
Bit
Symbol
Description
7
FIFOEN
Logic 1 indicates an enabled buffer memory with allocated
memory. Logic 0 indicates a disabled buffer memory (no bytes
allocated).
6
EPDIR
This bit de
fi
nes the endpoint direction (0 = OUT, 1 = IN); it also
determines the DMA transfer direction (0 = read, 1 = write).
5
DBLBUF
Logic 1 indicates that this endpoint has double buffering.
4
FFOISO
Logic 1 indicates an isochronous endpoint. Logic 0 indicates a
bulk or interrupt endpoint.
3 to 0
FFOSZ[3:0]
Selects the buffer memory size according to
Table 15
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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