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參數資料
| 型號： | AD9910 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | XO, clock |
| 英文描述： | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| 中文描述： | 1 GSPS的，14位，3.3伏的CMOS直接數字頻率合成 |
| 文件頁數： | 39/60頁 |
| 文件大小： | 764K |
| 代理商： | AD9910 |
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AD9910
Rev. 0 | Page 39 of 60
WAVEFORM START ADDRESS
WAVEFORM END ADDRESS
1
Δ
t
Δ
t
RAM ADRESS
RAM_SWP_OVER
I/O_UPDATE
M DDS CLOCK CYCLES
1
2
3
0
Figure 47. Continuous Bidirectional Ramp Timing Diagram
A change in state of the profile pins aborts the current waveform
and the newly selected RAM profile is used to initiate a new
waveform.
The RAM_SWP_OVR pin switches to Logic 1 when the state
machine reaches the waveform end address, then returns to
Logic 0 at the waveform start address, toggling each time one
of these addresses is reached.
A graphic representation of the continuous bidirectional ramp
mode is shown in Figure 47. The circled numbers indicate specific
events as follows:
Event 1—An I/O update or profile change has activated the RAM
continuous bidirectional ramp mode. The state machine initializes
to the waveform start address. The RAM_SWP_OVR pin resets to
Logic 0. The state machine begins incrementing through the
specified address range.
Event 2—The state machine reaches the waveform end address.
The RAM_SWP_OVR pin toggles to Logic 1.
Event 3—The state machine reaches the waveform start address.
The RAM_SWP_OVR pin toggles to Logic 0.
This action continues indefinitely until the next I/O update or
change in profile.
相關PDF資料 |
PDF描述 |
|---|---|
| AD9910_07 | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
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相關代理商/技術參數 |
參數描述 |
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