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參數資料
| 型號： | AD9910 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | XO, clock |
| 英文描述： | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| 中文描述： | 1 GSPS的，14位，3.3伏的CMOS直接數字頻率合成 |
| 文件頁數： | 6/60頁 |
| 文件大小： | 764K |
| 代理商： | AD9910 |
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AD9910
Parameter
201.1 MHz Analog Output
301.1 MHz Analog Output
401.3 MHz Analog Output
SERIAL PORT TIMING CHARACTERISTICS
Maximum SCLK Frequency
Minimum SCLK Clock Pulse Width
Maximum SCLK Rise/Fall Time
Minimum Data Setup Time to SCLK
Minimum Data Hold Time to SCLK
Maximum Data Valid Time in Read Mode
I/O_UPDATE/PS0/PS1/PS2 TIMING
CHARACTERISTICS
Minimum Pulse Width
Minimum Setup Time to SYNC_CLK
Minimum Hold Time to SYNC_CLK
Tx_ENABLE and 16-BIT PARALLEL (DATA) BUS
TIMING
Maximum PDCLK Frequency
Tx_ENABLE/Data Setup Time (to PDCLK)
Tx_ENABLE/Data Hold Time (to PDCLK)
MISCELLANEOUS TIMING CHARACTERISTICS
Wake-Up Time
2
Fast Recovery
Full Sleep Mode
Minimum Reset Pulse Width High
DATA LATENCY (PIPE_LINE DELAY)
Data Latency, Single Tone or using Profiles
Frequency, Phase, Amplitude-to-DAC Output
Rev. 0 | Page 6 of 60
Conditions/Comments
±500 kHz
±125 kHz
±12.5 kHz
±500 kHz
±125 kHz
±12.5 kHz
±500 kHz
±125 kHz
±12.5 kHz
Low
High
Min
Typ
–87
–87
–91
–86
–86
–88
–84
–84
–85
70
2
Max
11
Unit
dBc
dBc
dBc
dBc
dBc
dBc
dBc
dBc
dBc
Mbps
ns
ns
ns
ns
ns
ns
4
4
5
0
High
1
2
0
SYNC_CLK cycle
ns
ns
250
MHz
ns
ns
ms
SYSCLK cycles
μs
SYSCLK cycles
3
SYSCLK cycles
2
1
1
8
5
91
Matched latency enabled and OSK
enabled
Matched latency enabled and OSK
disabled
Matched latency disabled
Matched latency disabled
Matched latency enabled/disabled
Matched latency enabled
Matched latency disabled
Matched latency enabled/disabled
Matched latency enabled
Matched latency disabled
Matched latency enabled
Matched latency disabled
150
Frequency, Phase-to-DAC Output
79
SYSCLK cycles
Amplitude-to-DAC Output
Data Latency using RAM Mode
Frequency, Phase-to-DAC Output
Amplitude-to-DAC Output
Data Latency, Sweep Mode
Frequency, Phase-to-DAC Output
Amplitude-to-DAC Output
Data Latency, 16-Bit Input Modulation Mode
Frequency, Phase-to-DAC Output
79
47
94
106
58
91
91
47
103
91
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
SYSCLK cycles
相關PDF資料 |
PDF描述 |
|---|---|
| AD9910_07 | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| AD9910BSVZ | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| AD9910BSVZ-REEL | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
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相關代理商/技術參數 |
參數描述 |
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