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參數資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數據通信 |
| 文件頁數： | 151/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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151
Agere Systems Inc.
Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
9 SPE Mapper Registers
(continued)
Table 171. SPE_PTRCNT1—SPE_PTRCNT3, Receive Pointer Increment and Decrement Count (RO)
Table 172. SPE_RJ1MON_R1—SPE_RJ1MON_R32, Receive J1 Monitor Values (RO)
Table 173. SPE_TJ1DINS_R1—SPE_TJ1DINS_R32, Transmit J1 Insert Values (R/W)
Table 174. SPE_RJ1DEXP_R1—SPE_RJ1DEXP_R32, Receive J1 Expected Values (R/W)
Table 175. SPE_SCRATCH_R, Scratch Pad (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
0x000
0x00
0x000
0x30037
15:10
9:0
15:11
10:0
RSVD
Reserved.
Stored TU-3 Pointer Location.
Reserved.
Pointer Increment Count from Pointer
Interpreter Block.
The value of internal running
counter is transferred into this holding register
coincident with the end of a performance monitor
interval.
Reserved.
Pointer Decrement Count from Pointer
Interpreter Block.
The value of internal running
counter is transferred into this holding register
coincident with the end of a performance monitor
interval.
SPE_STORED_PTR[9:0]
RSVD
SPE_RPTR_INC[10:0]
0x30038
0x30039
15:11
10:0
RSVD
0x00
0x000
SPE_RPTR_DEC[10:0]
Address
Bit
Name
Function
Reset
Default
0x00
0x30042
—
0x30061
15:0
SPE_RJ1DMON[1—64][7:0]
Receive J1 Monitor Value.
These registers capture
a 64-byte sequence from the J1 byte of each frame.
Address
Bit
Name
Function
Reset
Default
0x00
0x30062
—
0x30081
15:0
SPE_TJ1DINS[1—64][7:0]
Transmit J1 Insert Value.
These registers allow a
64-byte sequence to be inserted into the J1 byte of
each frame.
Address
Bit
Name
Function
Reset
Default
0x00
0x30082
—
0x300A1
15:0
SPE_RJ1DEXP[1
—
64][7:0]
Receive J1 Expected Value.
These registers hold a
programmable 64-byte expected sequence for the J1
byte of each frame.
Address
Bit
Name
Function
Reset
Default
0x300A2
15:10
9:0
RSVD
SPE_SCRATCH[9:0]
Reserved.
Scratch Register.
Allows the control system to ver-
ify read and write operations to the device without
affecting device operation.
0x0000
相關PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
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| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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