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參數資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數據通信 |
| 文件頁數： | 214/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
214
Agere Systems Inc.
11 M13/M23 MUX/DeMUX Registers
(continued)
Table 256. M13_DS2_LB_DET_R, DS2 Loopback Detect Status (RO)
Table 257. M13_DS2_RSV_RCV_R, DS2 Receive Reserved Bit Delta Status (RO)
Table 258. M13_DS2DMX_LOC_R, DS2 DeMUX Loss of Clock Status (RO)
Table 259. M13_DS1_LOC_R[1—4], DS1 Loss of Clock Status Registers (RO)
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x10035
15:7
6:0
RSVD
Reserved
.
M13_DS2_LB_DET[7:1]
M13 Mode.
In the M23 mode (M13_M23_CBP = 1
(
Table 272 on page 219
)), the C bits in each received DS3
M-subframe are checked for loopback requests. If the third
C bit differs from the first and second C bits in the yth M-
subframe for five successive DS3 frames,
M13_DS2_LB_DETy is set to 1. M13_DS2_LB_DETy is
cleared when the third C bit does not differ from the first two
C bits in subframe y for five successive DS3 frames. In the
C-bit parity mode, M13_DS2_LB_DETy is fixed at 0.
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x10036
15:7
6:0
RSVD
Reserved
.
M13_DS2_RSV_RCV[7:1]
M13_DS2_RSV_RCVy Bit.
The M13_DS2_RSV_RCVy
bit changes state only after the reserved bit in the E1
mode (M13_DS1_E1Ny = 0) is received as the same
value for four consecutive DS2 frames. DS2 frame peri-
ods are not counted while M13_DS3_OOF = 1.
M13_DS2_RSV_RCVy is set equal to the reserved bit.
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x10037
15:7
6:0
RSVD
Reserved
.
M13_DS2DMX_LOC[7:1]
M13_DS2DMX_LOCy Bit
. A logic 1 of
M13_DS2DMX_LOCy bit indicates that loss of clock is
detected on the DS2 clock input, XC_DS2DMXCLKy.
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x00
0x00
0x0
0x00
0x00
0x00
0x1003C
0x1003D
0x1003E
0x1003F
0x1003C
0x1003D
0x1003E
0x1003F
15:4
15:8
15:8
15:8
3:0
7:0
7:0
7:0
RSVD
RSVD
RSVD
RSVD
Reserved.
Reserved.
Reserved.
Reserved.
The M13_DS1_LOCx bits indicate when loss of clock is
detected on a low-speed clock input, XC_DS1CLKx.
M13_DS1_LOC[28:25]
M13_DS1_LOC[24:17]
M13_DS1_LOC[16:9]
M13_DS1_LOC[8:1]
相關PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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