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參數資料
| 型號： | AFE7222EVM |
| 廠商： | Texas Instruments |
| 文件頁數： | 33/106頁 |
| 文件大小： | 0K |
| 描述： | EVAL MODULE FOR AFE7222 |
| 標準包裝： | 1 |
| 主要目的： | 接口，模擬前端（AFE） |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AFE7222 |
| 已供物品： | 板 |
| 其它名稱： | 296-30300 AFE7222EVM-ND |
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SLOS711B – NOVEMBER 2011 – REVISED MARCH 2012
Register Name – CONFIG50 – Address 0x137, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG5(15:8)
CHB_REG5(15:8) – Upper 8 bits for sample 5 for DAC B.
Register Name – CONFIG51 – Address 0x138, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG5(7:0)
CHB_REG5(7:0) – Lower 8 bits for sample 5 for DAC B
Register Name – CONFIG52 – Address 0x139, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG6(15:8)
CHB_REG6(15:8) – Upper 8 bits for sample 6 for DAC B.
Register Name – CONFIG53 – Address 0x13A, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG6(7:0)
CHB_REG6(7:0) – Lower 8 bits for sample 6 for DAC B.
Register Name – CONFIG54 – Address 0x13B, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG7(15:8)
CHB_REG7(15:8) – Upper 8 bits for sample 7 for DAC B.
Register Name – CONFIG55 – Address 0x113C, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG7(7:0)
CHB_REG7(7:0) – Lower 8 bits for sample 7 for DAC B
Register Name – CONFIG56 – Address 0x13D, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG8(15:8)
CHB_REG8(15:8) – Upper 8 bits for sample 8 for DAC B.
Register Name – CONFIG57 – Address 0x13E, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
CHB_REG8(7:0)
CHB_REG8(7:0) – Lower 8 bits for sample 8 for DAC B
Register Name – CONFIG58 – Address 0x13F, Default = 0x00
<7>
<6>
<5>
<4>
<3>
<2>
<1>
<0>
EN_IP_CLK_STOP_DET
EN_FIFO_COLLISION_DET
EN_FIFO_COLLISION_DET – On RESET (and when synced), the read and write pointers of the FIFO are
set 4 positions away. The read pointer increments at the DAC_DCLKIN rate whereas the write pointer
increments at the divided DAC_CLK rate. While the frequencies of these 2 clocks are expected to be the
same, relative phase drifts can cause this relative difference of 4 positions to drift. When the
EN_FIFO_COLLISION_DET bit is set, a collision condition is detected when the relative difference
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REGISTER DESCRIPTIONS
Copyright 2011–2012, Texas Instruments Incorporated
相關PDF資料 |
PDF描述 |
|---|---|
| ECE-V1EA100NP | CAP ALUM 10UF 25V 20% SMD |
| 0210491116 | CABLE JUMPER 1.25MM .305M 39POS |
| UPM1J270MED1TD | CAP ALUM 27UF 63V 20% RADIAL |
| RNF-100-1-1/4-RD-SP | HEAT SHRINK TUBING |
| RNF-100-1-1/4-BU-SP | HEAT SHRINK TUBING |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AFE7222IRGC25 | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數據速率:54 Mbps 噪聲系數: 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7222IRGCR | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數據速率:54 Mbps 噪聲系數: 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7222IRGCT | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數據速率:54 Mbps 噪聲系數: 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7225 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Analog Front End Wideband Mixed-Signal Transceiver |
| AFE7225EVM | 功能描述:射頻開發工具 AFE7225 Eval Mod RoHS:否 制造商:Taiyo Yuden 產品:Wireless Modules 類型:Wireless Audio 工具用于評估:WYSAAVDX7 頻率: 工作電源電壓:3.4 V to 5.5 V |
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