- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379673 > ARM720T (Electronic Theatre Controls, Inc.) General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip PDF資料下載
參數(shù)資料
| 型號： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴大寫入緩沖區(qū)和內(nèi)存管理單元（MMU）在單一芯片上結(jié)合 |
| 文件頁數(shù)： | 173/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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EmbeddedICE Logic
ARM DDI 0192A
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
8-21
1.
When the processor wishes to send a message to EmbeddedICE, it first checks
that the comms data write register is free for use. This is done by reading the
debug comms control register to check that the W bit is clear:
a.
If it is clear, the comms data write register is empty and a message is
written by a register transfer to the coprocessor. The action of this data
transfer automatically sets the W bit.
b.
If it is set, this implies that previously-written data has not been picked up
by the debugger and the processor must poll until the W bit is clear.
2.
Because the data transfer occurs from the processor to the comms data write
register, the W bit is set in the debug comms control register.
3.
When the debugger polls this register, it sees a synchronized version of both the
R and W bit:
a.
When the debugger sees that the W bit is set, it can read the comms data
write register and scan the data out.
b.
The action of reading this data register clears the W bit of the debug
comms control register. At this point, the communications process will
begin again.
8.8.3
Message transfer
Message transfer from the debugger to the processor is carried out in a similar fashion
to
Communications using the comms channel
on page 8-20:
1.
The debugger polls the R bit of the debug comms control register:
a.
If the R bit is LOW, the data read register is free and so data can be placed
there for the processor to read.
b.
If the R bit is set, previously deposited data has not yet been collected and
so the debugger must wait.
2.
When the comms data read register is free, data is written there using the scan
chain. The action of this write sets the R bit in the debug comms control register.
3.
When the processor polls this register, it sees an
MCLK
synchronized version:
a.
If the R bit is set, this denotes that there is data waiting to be collected, and
this can be read using a CPRT load. The action of this load clears the R bit
in the debug comms control register.
b.
If the R bit is clear, this denotes that the data has been taken and the
process can now be repeated.
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參數(shù)描述 |
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