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參數(shù)資料
| 型號(hào)： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴(kuò)大寫入緩沖區(qū)和內(nèi)存管理單元（MMU）在單一芯片上結(jié)合 |
| 文件頁數(shù)： | 54/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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Programmer
’
s Model
2-18
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
ARM DDI 0192A
2.8.4
Fast interrupt request
The FIQ exception is designed to support a data transfer or channel process. In ARM
state it has sufficient private registers to remove the necessity for register saving,
minimizing the overhead of context switching.
FIQ is externally generated by taking the
nFIQ
input LOW.
nFIQ
and
nIRQ
are
considered asynchronous, and a cycle delay for synchronization is incurred before the
interrupt can affect the processor flow.
Irrespective of whether the exception was entered from ARM or Thumb state, a FIQ
handler must leave the interrupt by executing:
SUBS PC, R14_fiq, #4
FIQ can be disabled by setting the CPSR F flag.
Note
This is not possible from User mode. If the F flag is clear, ARM720T checks for a LOW
level on the output of the FIQ synchronizer at the end of each instruction.
2.8.5
Interrupt request
The IRQ exception is a normal interrupt caused by a LOW level on the
nIRQ
input.
IRQ has a lower priority than FIQ and is masked out when a FIQ sequence is entered.
It can be disabled at any time by setting the I bit in the CPSR, though this can only be
done from a privileged (non-User) mode.
Irrespective of whether the exception was entered from ARM or Thumb state, an IRQ
handler must return from the interrupt by executing:
SUBS PC, R14_irq, #4
2.8.6
Abort
An abort indicates that the current memory access cannot be completed. It can be
signaled either by the protection unit, or by the external
BERROR
input. The
ARM720T checks for the abort exception during memory access cycles.
There are two types of abort:
Prefetch Abort
This
occurs during an instruction prefetch.
c.Where PC is the address of the Load or Store instruction that generated the
Data Abort.
d.The value saved in R14_svc upon reset is unpredictable.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AS-568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
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| AS-5 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-7 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ARM7DIMM-LPC2478 | 功能描述:模塊化系統(tǒng) - SOM LPC2478 ARM7 DIMM Module, Rev 2.2 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲(chǔ)容量:8 MB, 16 MB 存儲(chǔ)類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
| ARM7TDI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM7TDMI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:general purpose 32-bit microprocessors |
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
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