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參數(shù)資料
| 型號： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴大寫入緩沖區(qū)和內(nèi)存管理單元（MMU）在單一芯片上結(jié)合 |
| 文件頁數(shù)： | 52/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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Programmer
’
s Model
2-16
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
ARM DDI 0192A
2.8
Exceptions
Exceptions arise whenever the normal flow of a program has to be halted temporarily,
for example to service an interrupt from a peripheral. Before an exception can be
handled, the current processor state must be preserved so that the original program can
resume when the handler routine has finished.
Several exceptions can arise at the same time. If this happens, they are dealt with in a
fixed order. See
Exception priorities
on page 2-21.
2.8.1
Action on entering an exception
When handling an exception, the ARM720T:
1.
Preserves the address of the next instruction in the appropriate LR.
a.
If the exception has been entered from ARM state, the address of the next
instruction is copied into the LR (that is, current PC+4 or PC+8 depending
on the exception, See Table 2-3 on page 2-17 for details).
b.
If the exception has been entered from Thumb state, the value written into
the LR is the current PC, offset by a value so that the program resumes
from the correct place on return from the exception. This means that the
exception handler does not have to determine which state the exception
was entered from.
For example, in the case of SWI:
MOVS PC, R14_svc
always returns to the next instruction regardless of whether the SWI was
executed in ARM or Thumb state.
2.
Copies the CPSR into the appropriate SPSR.
3.
Forces the CPSR mode bits to a value which depends on the exception.
4.
Forces the PC to fetch the next instruction from the relevant exception vector.
It can also set the interrupt disable flags to prevent otherwise unmanageable nestings of
exceptions.
If the processor is in Thumb state when an exception occurs, it automatically switches
into ARM state when the PC is loaded with the exception vector address.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AS-568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-1 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-5 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-7 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ARM7DIMM-LPC2478 | 功能描述:模塊化系統(tǒng) - SOM LPC2478 ARM7 DIMM Module, Rev 2.2 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
| ARM7TDI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM7TDMI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:general purpose 32-bit microprocessors |
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
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