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參數資料
| 型號： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴大寫入緩沖區和內存管理單元（MMU）在單一芯片上結合 |
| 文件頁數： | 193/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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AMBA Interface
ARM DDI 0192A
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
10-11
BWAIT
does not prevent changes in
BTRAN[1:0]
and write data on
BD[31:0]
during
the cycle in which it was asserted HIGH. Changes in these signals are then prevented
until the
BCLK
HIGH phase after
BWAIT
was taken LOW. The addressing signals do
not change from the rising
BCLK
edge when
BWAIT
goes HIGH, until the next
BCLK
HIGH phase after
BWAIT
returns LOW.
In Figure 10-4, the heavy bars indicate the cycle for which signals are stable as a result
of asserting
BWAIT
.
Figure 10-4 Use of the BWAIT pin to stop ARM720T for 1 BCLK cycle
The signal
BTRAN[1:0]
is pipelined by one bus cycle. This pipelining must be taken
into account when these signals are being decoded. The value of
BTRAN[1:0]
indicates
whether the next bus cycle is a data cycle or an address cycle.
As bus cycles are stretched by
BWAIT
,
the boundary between bus cycles is determined
by the falling edge of
BCLK
when
BWAIT
was sampled as LOW on the rising edge
of
BCLK
. A useful general rule is to sample the value of
BTRAN[1:0]
on the
falling
edge of
BCLK
only when
BWAIT
was LOW on the previous
rising
edge of
BCLK
.
When
BWAIT
is used to stretch a sequential cycle,
BTRAN[1:0]
returns to signaling
address during the first phase of the sequential cycle if a single word access is occurring.
In this case, it is important that the memory controller does not interpret that an address
cycle is signaled when it is a stretched memory cycle.
Address
Seq
Address
Address
BCLK
BD[31:0]
Write
BTRAN[1:0]
BWAIT
BA[31:0]
BWRITE
BSIZE[31:0]
BLOK
BD[31:0]
Read
Data
Idle
cycle
Memory cycle
Idle
Cycle
Data
相關PDF資料 |
PDF描述 |
|---|---|
| AS-568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-1 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-5 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-7 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ARM7DIMM-LPC2478 | 功能描述:模塊化系統 - SOM LPC2478 ARM7 DIMM Module, Rev 2.2 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
| ARM7TDI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM7TDMI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:general purpose 32-bit microprocessors |
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
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