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參數資料
| 型號： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴大寫入緩沖區和內存管理單元（MMU）在單一芯片上結合 |
| 文件頁數： | 231/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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Signal Descriptions
ARM DDI 0192A
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
A-7
A.3
JTAG signals
JTAG signal descriptions are listed in Table A-3.
Table A-3 JTAG signal descriptions
Name
Type
Description
HIGHZ
Out
This signal denotes that the
HIGHZ
instruction has been loaded into the TAP controller.
IR[3:0]
Out
TAP instruction register.
These signals reflect the current instruction loaded into the TAP controller instruction register.
The signals change on the falling edge of
XTCK
when the TAP state machine is in the
UPDATE-DR state. You can use these signals to allow more scan chains to be added using the
ARM720T TAP controller.
RSTCLKBS
Out
Reset boundary scan clock.
This signal denotes that either the TAP controller state machine is in the RESET state or that
XnTRST
has been asserted. You can use this to reset boundary scan cells outside the
ARM720T.
SCREG[3:0]
Out
Scan chain register.
These signals reflect the ID number of the scan chain currently selected by the TAP controller.
These signals change on the falling edge of
XTCK
when the TAP state machine is in the
UPDATE-DR state.
SDINBS
Out
Boundary scan serial data in.
This signal is the serial data to be applied to an external scan chain.
SDOUTBS
In
Boundary scan serial data out.
This signal is the serial data from an external scan chain. It allows a single
XTDO
port to be
used. If an external scan chain is not connected, this input must be tied LOW.
TAPSM[3:0]
Out
Tap controller status.
These signals represent the current state of the TAP controller machine. These signals change
on the rising edge of
XTCK
and can be used to allow more scan chains to be added using the
ARM720T TAP controller.
TCK1
Out
Test clock one.
This clock represents the HIGH phase of
XTCK
.
TCK1
is HIGH when
XTCK
is HIGH. This
signal can be used to allow more scan chains to be added using the ARM720T TAP controller.
TCK2
Out
Test clock two.
This clock represents the LOW phase of
XTCK
.
TCK2
is HIGH when
XTCK
is LOW. You
can use this signal to allow more scan chains to be added using the ARM720T TAP controller.
TCK2
is the non-overlapping complement of
TCK1
.
XnTDOEN
Out
Not test data out output enable.
When LOW, this signal denotes that serial data is being driven out on the
XTDO
output.
相關PDF資料 |
PDF描述 |
|---|---|
| AS-568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-1 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-5 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-7 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ARM7DIMM-LPC2478 | 功能描述:模塊化系統 - SOM LPC2478 ARM7 DIMM Module, Rev 2.2 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
| ARM7TDI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM7TDMI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:general purpose 32-bit microprocessors |
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
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