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參數資料
| 型號： | ARM720T |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | General-purpose 32-bit Microprocessor with 8KB cache, enlarged Write buffer, and Memory Management Unit (MMU) combined in a single chip |
| 中文描述： | 通用32位微處理器與8KB的高速緩存，擴大寫入緩沖區和內存管理單元（MMU）在單一芯片上結合 |
| 文件頁數： | 229/242頁 |
| 文件大小： | 831K |
| 代理商： | ARM720T |
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Signal Descriptions
ARM DDI 0192A
Copyright ARM Limited 1997, 1998, 2000. All rights reserved.
A-5
A.2
Coprocessor interface signals
The coprocessor interface signals are listed in Table A-2.
Table A-2 Coprocessor interface signal descriptions
Name
Type
Description
CPCLK
Out
Coprocessor clock.
This clock controls the operation of the coprocessor interface.
CPDATA[31:0]
In/out
Coprocessor data bus.
Data is transferred to and from the coprocessor using this bus. Data is valid on the falling
edge of
CPCLK
.
CPDBE
In
Coprocessor data bus enable.
This signal when HIGH, indicates that the coprocessor intends to drive the coprocessor
data bus,
CPDATA.
If the coprocessor interface is not to be used then this signal must be
tied LOW.
CPnWAIT
Out
Coprocessor not wait.
The coprocessor clock
CPCLK
is qualified by
CPnWAIT
to allow the ARM720T to
control the transfer of data on the coprocessor interface.
CPTESTREAD
In
Coprocessor test read.
This signal can be used for test of a coprocessor, if attached, and must only be used with
the ARM720T held in reset. When HIGH, it enables
Data Bus
(DB) to be driven on to
CPDATA
, and must be held LOW. It must never be asserted at the same time as
CPTESTWRITE
.
CPTESTWRITE
In
Coprocessor test write.
This signal can be used for test of a coprocessor, if attached, and must only be used with
the ARM720T held in reset. When HIGH, it enables DB to be driven on to
CPDATA
,
and must be held LOW. It must never be asserted at the same time as
CPTESTREAD
.
EXTCPA
In
External coprocessor absent.
A coprocessor that is capable of performing the operation that ARM720T is requesting,
by asserting
nCPI
takes
EXTCPA
LOW immediately. If
EXTCPA
is HIGH at the end of
the low phase of the cycle in which
nCPI
went LOW, ARM720T aborts the coprocessor
instruction and takes the undefined instruction trap. If
EXTCPA
is LOW and remains
LOW, ARM720T busy-waits until
EXTCPB
is LOW, and then completes the
coprocessor instruction.
EXTCPB
In
External coprocessor busy.
A coprocessor that is capable of performing the operation that ARM720T is requesting,
by asserting
nCPI
, but cannot commit to starting it immediately, indicates this by driving
EXTCPB
HIGH. When the coprocessor is ready to start it takes
EXTCPB
LOW.
ARM720T samples
EXTCPB
at the low phases of each cycle in which
nCPI
is LOW.
相關PDF資料 |
PDF描述 |
|---|---|
| AS-568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS568 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-1 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-5 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
| AS-7 | SEMI-PRECISION POWER WIREWOUND RESISTOR |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ARM7TDI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM7TDMI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:general purpose 32-bit microprocessors |
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
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