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參數資料
| 型號： | PCF5083 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | STEEL COVER |
| 中文描述： | GSM信號處理IC |
| 文件頁數： | 118/136頁 |
| 文件大小： | 602K |
| 代理商： | PCF5083 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁當前第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁
1996 Oct 29
118
Philips Semiconductors
Objective specification
GSM signal processing IC
PCF5083
Host Interface timing
(see Figs 29 and 30)
1
2
3a
3b
4
5
6
7a
7b
8
(9)
9
10
(10)
11
12
13a
13b
14
HR/W setup time to HCEN LOW
HA0 to HA6 setup time to HCEN LOW
HD0 to HD7 setup time (HCEN_T)
HD0 to HD7 setup time (HCEN_D)
HD0 to HD7 hold time after HCEN HIGH
HR/W hold time after HCEN HIGH
HA0 to HA6 hold time after HCEN HIGH
HCEN pulse width (HCEN_T)
HCEN pulse width (HCEN_D)
DTACK LOW delay time, DSP write cycle
DTACK HIGH delay time, DSP read cycle; note 3
DTACK LOW delay time, DSP read cycle
DTACK LOW to data valid; note 11
DTACK HIGH delay time, DSP read cycle; note 3
HD0 to HD7 valid after HCEN LOW (HCEN_T)
HD0 to HD7 valid after HCEN LOW (HCEN_T)
HD0 to HD7 3-state after HCEN HIGH
5
5
t
13
10
10
5
10
3t
13
2t
dclkout
+ 20
30
40
30
35
40
50
3t
13
45
30
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
RF Device Control Bus timing - Mode 0
(see Fig.31; note 12)
1
2
3
4
5
6
7
(7)
RFEN1 to RFEN4 setup time to RFCLK LOW
RFEN1 to RFEN4 hold time after RFCLK HIGH
RFCLK HIGH time
RFCLK LOW time
RFDO setup time to RFCLK HIGH
RFDO hold time after RFCLK HIGH
RFDI setup time to RFCLK HIGH
70
4t
13
2t
13
6t
13
6t
13
10t
13
2t
13
ns
ns
ns
ns
ns
ns
ns
RF Device Control Bus timing - Mode 1
(see Fig.32; note 12)
1
2
3
4
5
6
7
(7)
RFEN1 to RFEN4 setup time to RFCLK HIGH
RFEN1 to RFEN4 hold time after RFCLK LOW
RFCLK LOW time
RFCLK HIGH time
RFDO setup time to RFCLK HIGH
RFDO hold time after RFCLK LOW
RFDI setup time to RFCLK LOW
70
4t
13
2t
13
6t
13
6t
13
4t
13
2t
13
ns
ns
ns
ns
ns
ns
ns
NO
PARAMETER
MIN.
TYP.
MAX.
UNIT
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