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參數(shù)資料
型號(hào)： AD9854
廠商： Analog Devices, Inc.
元件分類： XO, clock
英文描述： CMOS 300MHz Quadrature Complete-DDS
中文描述： 300MHz CMOS正交DDS數(shù)字合成器
文件頁(yè)數(shù)： 4/28頁(yè)
文件大小： 589K
代理商： AD9854
AD9854 PRELIMINARY TECHNICAL DATA
_____________________________________________________________________________________________________
AD9854 PRELIMINARY ELECTRICAL SPECIFICATIONS
(V
S
=+3.3 V
±
5%, R
SET
=3.9 k
,
External reference clock frequency = 30 MHz with REFCLK Multiplier enabled at 10
×
) unless otherwise noted.
7/16/99 REV.PRA
4
Parameter
Temp
Test Level
AD9854
Typ
Units
Min
Max
DAC Narrowband SFDR continued:
70 MHz Aout (
±
10 kHz)
90 MHz Aout (
±
1 MHz)
90 MHz Aout (
±
250 kHz)
90 MHz Aout (
±
50 kHz)
90 MHz Aout (
±
10 kHz)
110 MHz Aout (
±
1 MHz)
110 MHz Aout (
±
250 kHz)
110 MHz Aout (
±
50 kHz)
11 0MHz Aout (
±
10 kHz)
DAC SIGNAL-TO-NOISE RATIO (calculated)
Residual Phase Noise (Freq TBD)
1 kHz Offset
10 kHz Offset
100 kHz Offset
Pipeline Delays
TBD
Phase Accumulator & DSP Algorithm
Inverse Sinc Filter
Digital Multiplier
MASTER RESET DURATION
DIGITAL (AM) MULTIPLIER DYNAMIC RANGE
COMPARATOR INPUT CHARACTERISTICS
Input Capacitance
Input Resistance
Input Current
Hysteresis
Input Voltage Range
COMPARATOR OUTPUT CHARACTERISTICS
Logic "1" voltage, high Z load
Logic "0" voltage, high Z load
Output Power, 50-ohm load, 100 MHz toggle rate
Propagation Delay
Output Duty Cycle Error
3
Rise/Fall Time
Toggle Rate, high Z load
Toggle Rate, 50-ohm load
Output Jitter
4
COMPARATOR NARROWBAND SFDR
5
10 MHz (
±
1 MHz)
10 MHz (
±
250 kHz)
10 MHz (
±
50 kHz)
10 MHz (
±
10 kHz)
70 MHz (
±
1 MHz)
70 MHz (
±
250 kHz)
70 MHz (
±
50 kHz)
70 MHz (
±
10 kHz)
110 MHz (
±
1 MHz)
110 MHz (
±
250 kHz)
110 MHz (
±
50 kHz)
110MHz (
±
10 kHz)
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
V
V
V
V
V
V
V
V
V
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dB
+25°C
+25°C
+25°C
TBD
TBD
TBD
dBc/Hz
dBc/Hz
dBc/Hz
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
TBD
TBD
TBD
TBD
SysClk Cycles
SysClk Cycles
SysClk Cycles
SysClk Cycles
SysClk Cycles
dB
10
TBD
+25°C
+25°C
+25°C
+25°C
+25°C
V
IV
I
IV
IV
3
pF
k
μ
A
mV
V
500
±
12
10
0
V
DD
FULL
FULL
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
VI
VI
IV
IV
IV
IV
IV
IV
IV
+2.7
V
V
+0.4
10
3
±
5
1
300
400
3
dBm
ns
%
ns
MHz
MHz
ps RMS
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
+25°C
V
V
V
V
V
V
V
V
V
V
V
V
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
TBD
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
dBC
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PDF描述
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