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參數(shù)資料
| 型號： | L84302 |
| 元件分類： | 通用總線功能 |
| 英文描述： | L84302 Quad 100/10 Mbps 4-Port Ethernet Controller with RMON/SNMP Management Counters technical manual 4/02 |
| 中文描述： | L84302四100/10 Mbps的4端口以太網(wǎng)的遠(yuǎn)程監(jiān)控控制器/ SNMP管理處的技術(shù)手冊，4月2日 |
| 文件頁數(shù)： | 89/128頁 |
| 文件大小： | 997K |
| 代理商： | L84302 |
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Functional Description
Copyright 1997-2002 by LSI Logic Corporation. All rights reserved.
89 of 128
April, 2002
Bit 0 occurs on CDST0/CDST8 pin
There are two TX Transmit Status Registers that store the status of the
last two packets transmitted when TXOFF = 1 in Configuration 2 register.
When TXOFF = 0, the two TX Status Registers contain the oldest and
newest packet since the last read.
Table 35
TX Status Register Definition
7
6
5
4
3
2
1
0
TXUPDATE
R/LH
COL_LATE
R/LHI
DEFER
R/LH
CSN
R/LHI
GOOD_TX
R/LHI
COL_16
R/LHI
COL
R/LHI
UNF
R/LHI
Bit
Symbol
Name
Definition
R/W
Def.
7
TXUPDATE
Transmit Status
Updated
1 = Status has not been updated since
last read
0 = Updated since the last read
R/LH
1
6
COL_LATE
Late Collision
Error Detect
1 = Late collision occurred while packet
transmitted
0 = No error
R/LHI
0
5
DEFER
Packet Defer
Detect
1 = Transmission of packet was deferred
0 = No defer
R/LH
0
4
CSN
Carrier Sense
Error Detect
1 = Carrier sense error detected while
packet was being transmitted
0 = No error
R/LHI
0
3
GOOD_TX
Good Transmit
Packet Detect
1 = Transmit packet was good, i.e. suc-
cessfully transmitted without errors or
collisions
0 = No good
R/LHI
0
2
COL_16
16 Collision
Error Detect
1 = 16 or more collisions occurred while
the packet was being transmitted
0 = No error
R/LHI
0
1
COL
Collision Detect
1 = One or more collisions occurred
while the packet was being transmitted
0 = No collision
R/LHI
0
0
UNF
TX FIFO Under-
flow Detect
1 = Packet corrupted by TX FIFO under-
flow error
0 = No error
R/LHI
0
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