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參數資料
型號: 1215E
英文描述: TEST/JTAG SUPPORT|CMOS|QFP|48PIN|PLASTIC
中文描述: 測試/ JTAG支持|的CMOS | QFP封裝| 48PIN |塑料
文件頁數: 69/92頁
文件大小: 1041K
代理商: 1215E
Agere Systems Inc.
71
User Manual
April 2001
Advanced Operational Mode
497AE and 1215E Boundary-Scan Master 2
Appendix C—BSM2 (497AE) Data Sheet (continued)
Read/Write Cycle Timing—Synchronous Operation (continued)
It is important to notice that the BSM2 processor interface logic adopts a pipelined design to maximize the rate of
data transfer to and from the BSM2. As a result, following a write operation, the processor must wait for a period of
at least one TCKIN cycle before initiating a read cycle (see Figure 9).
5-6321 (F)
Figure 9. 497AE Write-then-Read Cycle Timing Diagram
5-6322 (F)
Figure 10. 497AE Read-then-Write Cycle with CE* Deasserted Between Cycles
READ CYCLE
WRITE CYCLE
RA
D[7:0]
TCKIN
CE*
DAV*
R/W*
WAIT
TCKIN
CE*
RA
R/W*
DAV*
D[7:0]
READ CYCLE
WRITE CYCLE
WAIT
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